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4位二进制加法计数器设计
实验要求
用原理图输入设计法或Verilog HDL文本输入设计法设计4位二进制加法计数器电路，建立4位二进制加法计数器的实验模式。通过电路仿真和硬件验证，进一步了解4位二进制加法计数器的功能和特性。
设计原理
4位二进制加法计数器的元件符号如图所示，CLK是时钟输入端，上升沿有效；CLRN是复位输入端，低电平有效；Q[3..0]是计数器的状态输出端；COUT是进位输出端。
答案
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第1题
第3题
试用 Verilog语言描述一个4位二进制可逆计数器的行为。要求如下：
(1)电路具有5种功能，即异步清零、同步置数、递增计数、递减计数和保持原有状态不变。且要求计数器能输出进位信号和借位信号，即当计数器递增计数到最大值时，产生一个高平有效的进位信号C0;当计数器递减计数到最小值0时，产生一个高电平有效的借位信号B0。
(2)用QuartusI软件进行逻辑功能仿真，并给出仿真波形。
第5题
由16×4位ROM和4位二进制加法计数器74LS161组成的脉冲分配电路如图7-13所示，ROM输入和输出关系如表7-4所示。试画出在CLK信号作用下D3、D2、D1、D0的波形。
表7-4 R0M输入和输出关系 | |||||||
| 地址输入 | 数据输出 | ||||||
| A3 | A2 | A1 | A0 | D3 | D2 | D1 | D0 |
| 0 0 0 0 0 0 0 0 1 1 1 1 1 1 1 1 | 0 0 0 0 1 1 1 1 0 0 0 0 1 1 1 1 | 0 0 1 1 0 0 1 1 0 0 1 1 0 0 1 1 | 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 | 1 0 0 0 0 1 1 1 1 1 0 0 0 0 0 0 | 1 0 0 1 1 0 0 0 1 1 0 0 0 1 1 0 | 1 0 1 0 0 1 0 0 1 0 0 1 0 0 1 0 | 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 |
第8题
图P5.18是由二进制优先权编码器CT74LS147(真值表参见表P5.18)和同步十进制加法计数器CT74160组成的可控分频器.试说明当输入控制信号
分别为低电平,并假定CP脉冲的频率为f0时,由Z端输出的脉冲的频率是多少？
第9题
第10题
设计一个温度控制电路。其输入为4位二进制数T3T2T1T0，代表检测到的温度。输出为X和Y，分别用来控制暖风机和冷风机的工作。当温度低于5时，暖风机工作，冷风机不工作；当温度高于10℃时，冷风机工作，暖风机不工作；当温度介于5℃和10℃之间时，暖风机和冷风机都不工作。用1表示暖风机和冷风机工作，用O表示暖风机和冷风机不工作。用与非门实现电路。
